Патенты автора Малашевич Наталья Иосифовна (RU)

Изобретение относится к аналого-цифровой измерительной электронике, в частности к аналого-цифровым преобразователям с промежуточным преобразованием напряжения в длительности импульсов. Технический результат - повышение точности преобразования аналогового сигнала. Аналого-цифровой преобразователь содержит цифровой синхронный счетчик 1, цифровой параллельный регистр 2, частотно-фазовый детектор 3, фильтр нижних частот 4, генератор 5, управляемый напряжением, цифровой делитель частоты 6. Выход цифрового параллельного регистра 2 выполнен в виде выходной шины и является выходом устройства. Фильтр нижних частот 4 выполнен на основе активного интегрирующего звена с двумя резистивными блоками. 1 з.п. ф-лы, 2 ил.

Изобретение относится к вычислительной технике. Технический результат заключается в увеличении диапазона выходного напряжения ячейки до уровня питающего напряжения при сохранении повышенной сбоеустойчивости. Ячейка оперативного запоминающего устройства содержит три последовательно соединенных инвертора, первый проходной ключ записи данных, выполненный из двух последовательно включенных транзисторов, схему подтверждения записанных данных, выполненную в виде двух параллельно соединенных комплементарных проходных ключей, один из которых соединен с прямым и инверсным входами адресной шины записи, а другой соединен с прямым и инверсным входами адресной шины выбора столбца; причем один выход третьего инвертора соединен с первой выходной разрядной шиной через второй комплементарный проходной ключ, соединенный с прямым и инверсным входами первой адресной шины чтения данных, а другой выход третьего инвертора соединен со второй выходной разрядной шиной через третий комплементарный выходной ключ, соединенный с прямым и инверсным входами второй адресной шины чтения данных. 1 з.п. ф-лы, 1 ил.

Изобретение относится к вычислительной технике. Технический результат заключается в увеличении диапазона выходного напряжения ячейки до уровня питающего напряжения при сохранении повышенной сбоеустойчивости, увеличении нагрузочной способности ячейки и напряжения выходного сигнала. Ячейка оперативного запоминающего устройства содержит три последовательно соединенных инвертора, а также первый проходной ключ записи данных для записи данных в ячейку с первой входной разрядной шины, второй проходной ключ записи данных для записи данных в ячейку со второй входной разрядной шины, комплементарный проходной ключ для передачи данных из ячейки на первую выходную шину, комплементарный проходной ключ для передачи данных из ячейки на вторую выходную шину, комплементарный проходной ключ перезаписи, управляемый четвертым инвертором и четырехвходовой схемой 2И-2ИЛИ-НЕ. 2 ил.

Изобретение относится к вычислительной технике. Технический результат заключается в повышении надежности, отказоустойчивости и сбоеустойчивости оперативного запоминающего устройства (ОЗУ). Ячейка памяти статического ОЗУ содержит три последовательно соединенных КМОП инвертора, включенных между шиной питания и шиной земли; первый проходной ключ, состоящий из двух последовательно соединенных адресных транзисторов, затворы которых соединены с адресной шиной записи и адресной шиной выбора столбца; второй проходной ключ в виде адресного транзистора, затвор которого соединен с адресной шиной считывания; схему подтверждения записанных данных, состоящую из двух параллельно соединенных комплементарных проходных ключей, один из которых соединен с прямым и инверсным входами адресной шины записи, а другой - с прямым и инверсным входами адресной шины выбора столбца; причем вход первого КМОП инвертора соединен через первый проходной ключ с первой разрядной шиной, выход первого КМОП инвертора соединен с входом второго КМОП инвертора; выход второго КМОП инвертора соединен с входом третьего инвертора и через схему подтверждения записанных данных с входом первого КМОП инвертора; выход третьего КМОП инвертора соединен через второй проходной ключ со второй разрядной шиной. 1 з.п. ф-лы, 1 ил.

 


Наверх