Патенты автора ШАРП Джеймс Патрик (US)
Изобретение относится к встроенному логическому анализатору и, в частности, к программируемому встроенному логическому анализатору для анализа электронной схемы. Устройство для тестирования и отладки электронной схемы, содержащее логический анализатор, имеющий первый вход, принимающий множество сигналов, и выход для обеспечения индикации обнаружения, с помощью логического анализатора, по меньшей мере одного запускающего события; и блок со встроенным самотестированием (BIST), имеющий первый вход для приема одного или более сигналов, появляющихся на первом входе логического анализатора, второй вход, соединенный с выходом логического анализатора для избирательного задействования блока BIST, причем блок BIST генерирует и поддерживает сигнатуру на основании первого и второго его входов. Технический результат заключается в расширении функциональных возможностей. 3 н. и 16 з.п. ф-лы, 17 ил.
