Патенты автора БАЕ Дзи Хиае (KR)
ПОЛУПРОВОДНИКОВОЕ ЗАПОМИНАЮЩЕЕ УСТРОЙСТВО // 2641478
Изобретение относится к вычислительной технике. Технический результат заключается в уменьшении количества сдвиговых регистров, используемых для запаздывания. Полупроводниковое запоминающее устройство, способное исполнять первый режим с первым запаздыванием и второй режим со вторым запаздыванием, большим, чем первое запаздывание, содержит блок контактных площадок, выполненный с возможностью принимать извне адрес и команду; первую схему задержки, выполненную с возможностью задерживать адрес на время, соответствующее первому запаздыванию; вторую схему задержки, включающую в себя сдвиговые регистры, соединенные последовательно и выполненные с возможностью задерживать адрес на время, соответствующее разнице между первым запаздыванием и вторым запаздыванием; и контроллер, выполненный с возможностью использовать первую схему задержки и вторую схему задержки при исполнении второго режима, причем первый режим и второй режим являются операциями записи или операциями считывания, и контроллер способен исполнять один из первого режима и второго режима. 11 з.п. ф-лы, 32 ил.
Группа изобретений относится к энергонезависимым запоминающим устройствам. Техническим результатом является увеличение числа битов адреса без изменений спецификаций устройства. Устройство содержит матрицу ячеек запоминающего устройства с банками, причем каждый банк включает в себя строки, первые линии слова, предоставленные в соответствии со строками, схему-защелку адресов, которая защелкивает сигнал первого адреса строки, декодер строк, который активирует одну из первых линий слова, и схему управления, которая выполнена с возможностью исполнять первую операцию, которая активирует один из банков на основе сигнала адреса банка, когда загружается первая команда, и вторую операцию, которая защелкивает сигнал первого адреса строки в схеме-защелке адресов, и исполнять третью операцию, которая активирует одну из первых линий слова посредством декодера строк на основе сигнала второго адреса строки и сигнала первого адреса строки, защелкиваемых в схеме-защелке адресов, когда вторая команда загружается после первой команды. 2 н. и 33 з.п. ф-лы, 21 ил.
