Устройство для обмена

 

ОПИСАНИЕ

ИЗОБРЕТЕНИЯ

К АВТОРСКОМУ СВМ ЕТВЛЬСТВУ

Союз Соаетскик

Социалистических

Республик

«»798775 (6т) Дополнительное к авт, сеид-ву. (53)М KilЗ

G 06 F 3/00 (22) Заявлено 09.1078 (2Ô) 2671637/18-24 с присоединением заявки Йо (23) Приоритет

Опубликовано 230181, Бюллетень ИР 3

Дата опубликования описания 30. 01. 81

Государственный комитет

СССР но делам изобретений и открытий (53) УДК 681. 327, .11(088.8) (72) Авторы изобретения

В.М.Антимиров, Т.С.Панова и В.A.Øàïoâàëîâ (71) Заявитель (54 ) УСТРОЙСТВО ДЛЯ ОБМЕНА

15

Изобретение относится к вычислительной технике и может быть использовано в цифровых вычислительных устройствах с асинхронным обменом ин формацией между блоками.

Известны устройства обмена с фиксированной продолжительностью цикла обмена, имеющие блок сопряжения и блок синхронизации, который формирует синхронизирующие импульсы через постоянные промежутки времени Г1) .

Однако при использовании устройства обмена для передачи информации между разными блоками, имеющими различные временные характеристики, необходимо разрабатывать вновь блок сопряжения и блок синхронизации.

Известно устройство, содержащее 20 несколько переключаемых генераторов синхросигналов, что позволяет производить обмен с несколькими фиксированными скоростями Г2).

Недостатком этого устройства яв- 25 ляется то, что при необходимости организовать обмен между большим числом разнотипных блоков требуется большое число генераторов синхросигналов. ЗО

Указанные недостатки устранены в устройствах с асинхронным обменом управляемых сигналами запроса и готовности к обмену, формируемыми соответственно ведущим и ведомым обменивающимися устройствами.

Наиболее близким по технической сущности к предлагаемому является устройство, содержащее блок формирования сигнала прерывания, который по сигналу обращения подает на участвующую в обмене ЭВМ сигнал прерывания. Сигналом прерывания ЭВМ устанавливается в режим динамического останова до последующего г.рерывания запросом на обработку данных

g3) .

Недостатком этого устройства является то, что после появления сигнала расходуется дополнительное время, длительность которого определяется длительностью цикла между моментами анализа сигнала. При программной организации анализа сигнала зто время может достигать нескольких ьыкросекунд, что при передаче значительных потоков информации, например между блоком переработки (процессором) и запоминающим блоком является неприемлемым.

798775

Цель Изобретения — повышение быстродействия устройства.

Эта цель достигается тем, что в устройство введены коммутатор и блок управления, первый выход которого соединен с установочным входом формирователя синхроимпульсов, второй выход которого соединен с первым стробирующим входом блока управления, к второму стробирующему входу которого подключен первйй выход задающего генератора, вторОй выход которого подсоединен к входу коммутатора, выход которого подключен к синхронизирующему входу формирователя синхроимпульсов, управляющий вход коммутатора подключен к второму выходу блока управления, первый управляющий вход которого является первым входом устройства, второй управляющий вход его — вторым входом устройства, а третий управляющий вход— третьим входом устройства. Блок управления содержит триггер RS-типа, два элемента И и элемент ИЛИ, первый вход которого является первым управляющим входом блока, второй вход элемента ИЛИ является третьим управляющнм входом блока, а выход его подключен к первому входу первого эле-. мента И, второй вход которого является вторым стробирующим входом блока, а выход его соединен с первым установочным входом триггера RS òèпа, к второму установочному входу которого подключен выход второго элемента И, который является первым выходом блока, первый вход второго элемента И является первым стробирующим входом блока, второй вход второго элемента И является вторым управляющим входом блока, выход триггера RS-типа является вторым выходом блока.

На фиг. 1 представлена структурная схема предлагаемого устройства; на фиг. 2 — схема блока управления.

Устройство содержит блок 1 переработки информации, запоминающий блок 2, формирователь 3 синхроимпульсов, задающий генератор 4, блок 5 управления, коммутатор б.

Блок управления содержит первый

7 и второй 8 элементы И, элемент

ИЛИ 9 и триггер 10 RS-гипа. . Блок переработки и запоминающий блок связаны информационными и управляющими связями, к которым могут быть подключены внешние устройства.

Первый и второй .Управляющие входы блока управления подключены соответственно к выходу запоминающего блока и выходу блока переработки. Третий управляющий вход блока управления является входом Устройства, к которому может подключаться внешнее запоминающее устройство. Синхронизирующий вход блока переработки подключен.к первому выходу формироват .— ля синхроимпульсов. Второй выход этого формирователя подключен к первому стробирующему входу блока управления, к его второму стробирующему входу подключен первый выход задающего генератора. Первый выход блока управления подключен к установочному входу формирователя синхроимпульсов, а второй выход блока— к управляющему входу коммутатора, вход которого подключен к второму выходу задающего генератора, а выход к синхронизирующему входу формирователя синхроимпульсов.

Первый управляющий вход блока управления является первым входом

15 элемента ИЛИ 9, второй вход которого является третьим управляющим входом блока, а выход подключен к первому входу первого элемента И 7, выход которого подключен к первому

20 установочному входу триггера 10, а второй вход первого элемента И является вторым стробирующим входом блока. Первый и второй входы второго элемента И 8 являются соответ2 ственно первым стробирующим и вторым управляющим входами блока. Выход этой схемы является первым выходом блока и подключен к второму установочному входу триггера, выход которого является вторым выходом блока.

Устройство для обмена работает следующим образом.

Задающий генератор вырабатывает последовательность импульсов, проходящих через коммутатор на вход формирователя. Формирователь циклически вырабатывает серии синхроимпульсов, поступакщих в блок переработки. При обращении к запоминающему блоку, блок

40 переработки формирует одновременно с сигналом обращения к запоминающему блоку и сигнал запроса, поступающий на второй управляющий вход блока управления, формирователь 3 заканчивает по установочному сигналу вырабоку серии синхроимпульсов, обеспечивающих завершение переработки информации в блоке 1, и по окончании последнего необходимого для

0 обработки синхроимпульса (СИ) формирует управляющий сигнал для коммутатора б. По этому сигналу коммутатор отключает задающий генератор 4 от формирователя 3, на синхронизирующий вход которого перестают по 5 ступать высокочастотные импульсы.

Очередной СИ не вырабатывается и блок 1 переходит в режим статического останова. Сигнал, управляющий коммутатором б в блоке управления фиксируется на триггере.

После окончания процесса выборки информации запоминакщий блок формирует сигнал "Готовность", поступающий на первый управляющий вход бло ка управления. По совпадению этого 98775 сигнала с импульсом высокой частоты, поступающему из задающего генератора, управляющий сигнал с входа коммутатора снимается (триггер 10 возвращается в первоначальное состояние), на вход формирователя начинают поступать импульсы высокой частоты с задающего генератора и формирователь вырабатывает синхроимпульс, по которому в блоке переработки производится обработка информации, поступившей из запоминающего блока в магистральные шины. Стробирование сигналов импульсами высокой частоты производится для исключения временных неопределенностей при работе схем.

В том случае, если время выборки из запоминающего блока мало и сигнал готовности появляется до синхроимпульса, по которому ведется обработка, останова не происходит. Работа происходит аналогично, если обращение ведется к внешнему устройству.

Введение блока управления, коммутатора и организации их связей в устройстве обеспечивает остановку выработки синхроимпульсов, начиная с синхроимпульса, по которому ведется обработка информации, принимаемой из запоминающего блока. Останов продолжается до момента появления сигнала "Готовность" на выходе запоминающего блока, свидетельствующего о наличии информации в магистральных шинах. Поскольку привязка сигнала "Готовность" производится к импульсам высокой частоты, период следования которых составляет .в современных устройствах 30-50 нс, то только этим и определяются потери времени при обмене, так как время срабатывания триггера укладывается в полупериод высокой частоты.

Устройство позволяет организовать асинхронный обмен, практически без потерь времени на обработку сигналов "запрос-ответ" и обеспечивает при обмене сокращение потерь времени от нескольких сотен наносекунд до микросекунд по сравнению с известными устройствами асинхронного обмена, в том числе и использующими режим динамического остано-. ва. Это позволяет стыковать блок обработки с запоминающим блоком, существенно отличающимися друг от друга быстродействием, при этом в каждом случае бЫстродействие при.обмене является максимальным для данного запоминающего блока и блока обработки. При наличии быстродействующего запоминающего блока, когда блок переработки работает медлен5

$0

О

dO но относительно запоминающего блока, скорость передачи полностью определяется блоком переработки, без дополнительных задержек.

Формула изобретения

1. Устройство для обмена, содержащее формирователь синхроимпульсов и задакщий генератор, причем первый выход формирователя синхроимпульсов является выходом устройства, о т— л и ч а ю щ е е с я тем, что, с целью повышения быстродействия устройства, в него введены коммутатор и блок управления, первый выход которого соединен с установочным входом формирователя.синхроимпульсов, второй выход которого соединен с первым стробирующим входом блока управления, к второму стробирующему входу которого подключен первый выход задающего генератора, второй выход которого подсоединен к входу коммутатора, выход которого подключен к синхронизирующему входу формирователя синхроимпульсов, управляющий вход коммутатора подключен к второму выходу блока управления, первы управляющий вход которого является первым входом устройства, второй управляющий вход его — вторым входом устройства, а третий управляющий вход - третьим входом устройства.

2. Устройство по и. 1, о т л ич а ю щ е е с я тем, что блок управления содержит триггер RS-типа, два элемента И и элемент ИЛИ, первый вход которого является первым управляющим входом блока, второй вход элемента ИЛИ является третьим управляющим входом блока, а выход его подключен к первому входу первого элемента И, второй вход которого является вторим стробирующим входом блока, а выход его соединен с первым установочным входом триг- гера RS- òèëà, к второму установочному входу которого подключен выход второго элемента И, который является первым выходом блока, первый вход . второго элемента И является первым стробирующим входом блока, второй вход второго элемента И является вторым управляющим входом блока, выход триггера RS-типа является вторым выходом блока.

Источники информации, принятые во внимание прн экспертизе

1. Авторское свидетельство СССР

Р 369562, кл. G 06 F 3/00, 1971 °

2. Патент CQJA Р 4052702, кл. 340-178.5, 1977.

3. Патент Японии 9 50-29772, кл. 97/7 D 1, 1975 (прототип).