Патенты автора Маслов Сергей Петрович (RU)
Изобретение относится к цифровой вычислительной технике и предназначено для создания цифровых устройств троичной логики. Техническим результатом является повышение быстродействия, снижение размеров и энергопотребления устройства. Устройство содержит 30 транзисторов, 2 диода, 1 резистор и источник тока. 1 ил., 4 табл.
УСТРОЙСТВО ТРОИЧНОГО СЛОЖЕНИЯ И ВЫЧИТАНИЯ // 2645279
Изобретение относится к устройствам цифровой вычислительной техники, в частности к недвоичной схемотехнике, и предназначено для создания устройств троичной арифметики. Техническим результатом является реализация устройства троичного сложения и вычитания. Устройство содержит 10 пороговых элементов троичной логики, узел троичной схемотехники и троичный полный последовательный сумматор. 1 ил., 5 табл.
ТРОИЧНОЕ МНОЖИТЕЛЬНОЕ УСТРОЙСТВО // 2642408
Изобретение относится к устройствам цифровой вычислительной техники, в частности к недвоичной схемотехнике, и предназначено для создания троичного множительного устройства. Технический результат заключается в расширении арсенала средств. Устройство содержит типовые узлы: троичные регистры сдвига, троичные сумматоры, троичные D-триггеры и троичные поразрядные умножители. 3 ил., 3 табл.
ТРОИЧНЫЙ ПОРАЗРЯДНЫЙ УМНОЖИТЕЛЬ // 2631166
Изобретение относится к устройствам цифровой вычислительной техники и предназначено для создания устройств троичной арифметики схемотехники. Технический результат заключается в расширении арсенала средств. Устройство содержит пороговые элементы троичной логики, связанные между собой сборками. 1 ил., 4 табл.
Изобретение относится к цифровой вычислительной технике, в частности к недвоичной технике, и предназначено для создания цифровых устройств троичной логики. Техническим результатом является реализация порогового элемента троичной логики на токовых зеркалах. Устройство содержит 16 транзисторов, 6 диодов, 3 резистора и источник тока. 1 ил., 1 табл.
Группа изобретений относится к устройствам цифровой вычислительной техники, в частности к недвоичной схемотехнике, и предназначена для создания цифровых устройств троичной логики. Техническим результатом является реализация троичных полных последовательных сумматоров. В одном из вариантов троичный полный сумматор на два входа содержит два троичных полусумматора и троичный D-триггер. 2 н.п. ф-лы, 3 ил., 4 табл.
ТРОИЧНЫЙ РЕВЕРСИВНЫЙ РЕГИСТР СДВИГА // 2585263
Изобретение относится к устройствам цифровой вычислительной техники, в частности к недвоичной схемотехнике. Технический результат заключается в обеспечении в среде интегральной полупроводниковой электроники устройств на основе симметричной троичной системы с цифрами +1, 0 и -1. Технический результат достигается за счет включения в троичного реверсивного регистра сдвига, который содержит троичные дешифраторы 1×3, троичные мультиплексоры, троичные D-триггеры и два пороговых элемента троичной логики. 2 ил., 3 табл.
Группа изобретений относится к устройствам цифровой вычислительной техники, в частности к недвоичной схемотехнике, и предназначена для создания троичных счетных триггеров и счетчиков. Техническим результатом является создание троичного триггера со счетным входом (Т-триггера) и троичного реверсивного счетчика, содержащего троичный триггер. Троичный Т-триггер содержит узел троичной схемотехники, троичный полусумматор, троичный D-триггер и пять пороговых элементов троичной логики. 2 н.п. ф-лы, 6 ил., 6 табл.
ТРОИЧНЫЙ D-ТРИГГЕР (ВАРИАНТЫ) // 2510129
Группа изобретений относится к устройствам цифровой вычислительной техники, в частности к недвоичной схемотехнике, и предназначена для создания троичных триггеров. Техническим результатом заявляемой группы изобретений является реализация схемотехнических средств, используемых для создания троичных логических устройств в среде интегральной полупроводниковой электроники, за счет включения в их состав троичных D-триггеров. В одном из вариантов троичный D-триггер с записью по уровню содержит узел троичной схемотехники и семь пороговых элементов троичной логики. 4 н.п.ф-лы, 5 ил., 6 табл.
Изобретение относится к цифровой вычислительной технике и может быть использовано для реализации на ненасыщенных комплементарных биполярных транзисторах троичных логических устройств
