Элемент памяти для динамического оперативного запоминающего устройства

 

Изобретение относится к вычислительной технике и может быть использовано для создания интегральных динамических оперативных запоминающих устройств (ДОЗУ) с произвольной выборкой. Целью изобретения является повышение степени интеграции ДОЗУ. Сущность изобретения: в элементе ДОЗУ, содержащем полупроводниковую подложку с первой и второй областями 2 и 3 противоположного подложке типа проводимости и отделенный от подложки слоем 5 диэлектрика первый проводящий электрод 4 , причем внутри второй области сформирована третья область 6 совпадающего с подложкой типа проводимости, внутри третьей области сформирована четвертая область 7 противоположного подложке типа проводимости, а часть поверхности второй области между третьей областью и подложкой покрыта слоем 8 диэлектрика, на котором сформирован второй проводящий электрод 9. 2 ил.

Изобретение относится к вычислительной технике и может быть использовано для создания интегральных ДОЗУ с произвольной выборкой.

Целью изобретения является повышение степени интеграции ДОЗУ.

На фиг. 1 представлена конструкция элемента ДОЗУ; на фиг. 2 - его электрическая схема.

Элемент содержит полупроводниковую подложку 1, например кремния р-типа проводимости с концентрацией дырок 1015 - 1016 см-3. В подложке 1 сформирована область 2 n-типа проводимости с концентрацией электронов 1019 - 1020 см-3 и область 3 n-типа проводимости глубиной 1-2 мкм с концентрацией электронов 1016 - 1017 см-3. Между ними расположен проводящий электрод 4, например из поликремния, отделенный от подложки слоем диэлектрика 5, например окисла кремния толщиной 20-50 нм. Области 2 и 3 и электрод 4 представляют собой соответственно, сток, исток и затвор МДП транзистора считывания. Внутри области 3 сформирована область 6 р-типа проводимости с концентрацией дырок 1017 - 1018 см-3, а внутри нее - область 7 n-типа проводимости с концентрацией электронов 1019 - 1020 см-3.

В конструкции элемента ДОЗУ (фиг. 1) в подложке 1 внутри области 6 выполнена канавка 10, например с вертикальными стенками, глубина которой больше глубины области 3 так, что часть поверхности области 3 между областью 6 и подложкой 1 выходит на боковую стенку канавки 10. Слой диэлектрика 8 и электрод 9 расположены внутри канавки 10, которая окружает каждую пару элементов и выполняет роль межэлементной изоляции.

Предложенный элемент ДОЗУ работает следующим образом.

Сток 2 и затвор 4 МДП транзистора считывания соединены соответственно с разрядной и адресной шинами накопителя. На подложку 1, эмиттер 7 биполярного транзистора и затвор 9 дополнительного МДП транзистора подается потенциал земли. В режиме хранения на затвор 4 МДП транзистора считывания подается запирающий потенциал, на области 6 находится потенциал земли, а в области 3 хранится потенциал земли, если емкость 11 коллекторного перехода биполярного транзистора разряжена, или питания, если емкость 11 заряжена.

В режиме чтения на сток 2 МДП транзистора считывания подается плавающий потенциал питания, а на его затвор 4 - отпирающий потенциал. Если емкость 11 была заряжена, то никакие токи не потекут, и на разрядной шине останется потенциал питания. Если же емкость 11 была разряжена, то напряжение с разрядной шины через сопротивление канала открытого транзистора считывания попадает на коллектор 3 и перераспределяется между емкостями 11 и 12 коллекторного и эмиттерного переходов. Как только напряжение на эмиттерном переходе достигает 0,6 В, биполярный транзистор открывается. Дополнительный МДП транзистор в это время закрыт, так как на его подложке 3 находится потенциал питания. Биполярный транзистор будет открыт, разряжая коллекторным током емкость разрядной шины 13, до тех пор пока емкость 11 не зарядится базовым током до напряжения на разрядной шине, после чего биполярный транзистор закроется. Отношение величины считанного заряда к величине хранимого близко к коэффициенту усиления биполярного транзистора. В режиме записи на сток 2 МДП транзистора считывания подается потенциал земли или питания, после чего на его затвор 4 подается отпирающий потенциал. При записи 0 дополнительный МДП транзистор открыт, так как на его подложке 3 находится потенциал земли, и на областях 3 и 6 установится потенциал земли. При записи 1 на области 3 установится потенциал питания и емкость 12 будет заряжена.

Таким образом, предложенный элемент ДОЗУ управляется аналогично однотранзисторному элементу, а его использование при коэффициенте усиления биполярного транзистора свыше 100 позволяет на порядок увеличить количество элементов, подключаемых к одной разрядной шине, при одновременном уменьшении на порядок емкости конденсаторов хранения. Это позволит более чем в 10 раз повысить степень интеграции ДОЗУ.

Формула изобретения

ЭЛЕМЕНТ ПАМЯТИ ДЛЯ ДИНАМИЧЕСКОГО ОПЕРАТИВНОГО ЗАПОМИНАЮЩЕГО УСТРОЙСТВА, содержащий полупроводниковую подложку, в приповерхностной области которой размещены первая и вторая области противоположного подложке типа проводимости, на поверхности подложки между первой и второй областями расположен слой диэлектрика, на поверхности которой размещены первый проводящий электрод, причем внутри второй области размещена третья область, тип проводимости которой совпадает с проводимостью подложки, отличающийся тем, что, с целью повышения степени интеграции, внутри третьей области размещена четвертая область противоположного подложке типа проводимости, а также выполнена канавка, глубина которой перекрывает глубину второй области, на торцевой поверхности канавки, примыкающей к третьей области, расположен второй слой диэлектрика, на поверхности которого размещен второй проводящий электрод.

РИСУНКИ

Рисунок 1, Рисунок 2



 

Похожие патенты:

Изобретение относится к запоминающим устройствам, запись и считывание информации в которых осуществляется с помощью зонда сканирующего туннельного микроскопа

Изобретение относится к микроэлектронике и может быть использовано в полупроводниковых ИС в качестве ячейки памяти

Изобретение относится к запоминающим устройствам на биполярных транзисторах

Изобретение относится к запоминающим устройствам на биполярных транзисторах Цель-повышение быстродействия и помехоустойчивости запоминающего устройства - достигается с помощью изменений связей транзисторов, что позволяет повысить логические перепады в режиме считывания и исключить влияние переходных процессов на задержку выборки элементов памяти

Изобретение относится к способам изготовления полупроводниковых приборов и может быть использовано для изготовления электрически непрограммируемых МДП-элементов памяти с большим числом циклов переключения

Изобретение относится к микроэлектронике и может быть использовано в полупроводниковых ИС в качестве элемента памяти

Изобретение относится к полупроводниковой электронике и вычислительной технике и может быть использовано в разработках запоминающих устройств сверхбольшой емкости

Изобретение относится к микроэлектронике и может быть использовано в интегральных оперативных запоминающих устройствах (ОЗУ)

Изобретение относится к полупроводниковой электронике и вычислительной тех нике и может быть использовано в разработках запоминающих устройств сверхбольшой емкости

Изобретение относится к вычислительной технике

Изобретение относится к микроэлектронике и может быть использовано для создания ЭРПЗУ с повышенной информационной плотностью на основе МОНОП-транзисторов, в частности, перепрограммируемых инжекцией горячих носителей заряда

Изобретение относится к вычислительной технике и может быть использовано для создания постоянных (ПЗУ) и репрограммируемых (РПЗУ) запоминающих устройств повышенной информационной емкости на основе МДП-структур

Изобретение относится к полупроводниковому запоминающему устройству и, в частности, к цепи усиления напряжения (употребляемый здесь термин "цепь усиления напряжения" имеет тот же смысл, что и "усилительная схема", "цепь выработки усиленного напряжения", "однокаскадная усилительная схема с компенсационной обратной связью" и т.д.) для усиления подаваемого от системы питающего напряжения до желательного уровня усиления напряжения

Изобретение относится к вычислительной цифровой технике, конкретно к конструкции ячейки памяти с вертикально расположенными друг над другом пересечениями

Изобретение относится к способу регенерации ячеек памяти в динамическом запоминающем устройстве с произвольным доступом и, в частности, к способу, который уменьшает помехи регенерации на напряжении стока динамического запоминающего устройства с произвольным доступом, имеющего КМОП-структуру

Изобретение относится к электронной технике

Изобретение относится к запоминающей ячейке статического ЗУПВ

Изобретение относится к схемному устройству с некоторым числом электронных схемных компонентов, состояние которых может переводится в исходное состояние
Наверх