Устройство для формирования тестов

 

Изобретение относится к вычислительной технике. Цель изобретения состоит в повышении быстродействия устройства. Устройство состоит из генератора тактовых импульсов, генератора псевдослучайных чисел, блока синхронизации, счетчика длины т.еста, блока задания исходных данных, трёх регистров сдвига, двух счетчиков, мультиплексора, элемента И, группы элементов И, группы триггеров, блока памяти и узла коммутации. Устройство позволяет проводить в автокатическом режиме синтез и генерацию тестовых последовательностей. 7 ил. да

СОЮЗ СОВЕТСКИХ

СОЦИАЛИСТИЧЕСКИХ

РЕСПУБЛИК

„„SU„„1429121 (5D 1 G 06 F 11/26

ОПИСАНИЕ ИЗОБРЕТЕНИЯ

ГОСУДАРСТВЕННЫЙ НОМИТЕТ СССР

ПО.ДЕЛАМ ИЗОБРЕТЕНИЙ И ОТНРЫТИЙ

К А BTOPCHOMV СВИДЕТЕЛЬСТВУ (21 ) 4196666/24-24 (22) 19.02.87 (46) 07.10.88. Бюл. 11 37 (71) Минский радиотехнический институт (72) И,П.Кобяк и В.М,Галецкий (53) 681.3(088.8) (56) Авторское свидетельство СССР

У 1149265, кл. G 06 F 11/26, 1984.

Авторское свидетельство СССР

Ф 1297059, кл. G 06 F 11/26, 1985. (54) УСТРОЙСТВО ДЛЯ ФОРМИРОВАНИЯ ТЕСТОВ (57) Изобретение относится к вычислительной технике. Цель изобретения состоит в повышении быстродействия устройства. Устройство состоит из генератора тактовых импульсов, генератора псевдослучайных чисел, блока. синхронизации, счетчика длины таста, блока задания исходных данных, трех регистров сдвига, двух счетчиков, мультиплексора, элемента И, группы элементов И, группы триггеров, блока памяти и узла коммутации. Устройство . позволяет проводить в автоматическом режиме синтез и генерацию тестовых последовательностей. 7 ил.

1429121

Изобретение относится к автоматике и вычислительной технике и может рыть использовано при производствен-!

1лом контроле интегральных схем, а также узлов и блоков на основе этих схем.

Цель изобретения - повышение быстродействия.

На фиг, 1 показана блок-схема

° ° ° стройства; на фиг. 2 — блок синхро— зации, на фиг. 3 — блок памяти и егистры сдвига; на фиг. 4 — взаимовязь отдельных элементов устройства;

8а фиг. 5 - схемотехнические взаимо- 15 связи блоков, приведенных на фиг. 4, При т=3, где m — - максимальное число фходов объекта контроля, на фиг. 6— счетчик с переменным модулем счета; иа фиг. 7 — мультиплексор. 20

Устройство (фиг. 1) содержит генератор 1 тактовых импульсов, генератор псевдослучайных чисел, блок 3 синхронизации, счетчик 4 длины теста, блок 5 задания исходных данных, регистры 6 и 7 сдвига, счетчик 8 (с переменным модулем счета), счетчик

9, мультиплексор 10 регистр 11 сдвига, элемент И 12, груп у 13 элементов

И, гругпу триггеров 14, блок 15 памя- 30 ти„ узел 16 коммутации, вход 17 задания режима работы устройства.

Блок синхронизации (фиг, 2) содержит регистр 18, блок 19 памяти (ПЗУ команд),.коммутатор 20, счетчик

2l элемент И 22, элемент ИЛИ 23, триггер 24, элементы 25 и 26 индикации, блок 27 задания начального ад1 реса.

Счетчик (фиг. 6 ) содержит группу 4р триггеров 28. 1...28, группу элементов

2-2И-ИЛИ 29,1...29, (-1), группу элементов ИЛИ (30. 1... 30, ) -1 ), Рассмотрим основные функции, выполняемые из блоков устройства. 45

Генератор 1 тактовых импульсов предназначен для синхронизации работы узлов устройства для формирования тестов.

Генератор 2 псевдослучайных чисел предназначен для выработки последовательности равновероятных двоичных символов с эталонными статистическими характеристиками. Работа генератора синхронизируется импульсами генерато-55 ра тактовых импульсов (ГТИ), Установочные Я-входы триггеров сдвигового регистра соединены с блоком 3 синхронизации и служат для предварительной установки генератора в исходное состояние перед началом проверки цифрового блока.

Блоа 3 синхронизации (иг. 7) предназначен для формирования управляющих и синхронизирующих сигналов, необходимых дпя работы устройства в целом. В состав блока входят микропрограммное устройство управления, состоящее из регистра адреса и ЛЗУ, блока двухвходовых элементов И, В$-триггера, счетчика адреса блока 15 памяти, элементы коммутации и индикации.

Блок переключателей служит для .предварительного занесения в регистр адреса микрокоманды (PANK) начального ад" ре а микропрограммы, записанной в ПЗУ.

Верхнее положение переключателя соответствует подаче уровня логической едглницы, нижнее положение — логического нуля. На вход синхронизации С!

РАИК подается единичный потенциал, ин лциирующий запись в регистр. Записанная информация является начальным адpecqM микропрограммы, считываемой из ПЗУ. Наличие свечения индикатора свидетельствует о том, что триггер находится в единичном состоянии, т.е. выбрана область памяти, в которой хранятся команды условного перехода или останова, Считанная из ПЗУ микрокомандя состоит из двух полей — поля адреса следующей микрокоманды и поля управляющих сигналов. После адреса следующей микрокоманды имеет разрядность, равную q+1 поле управляющих. сигналов является пятнадцатиразрядным, причем двенадцатый У„ и тринадцатый У„ управляющие сигналы служат для управления счетчиком адреса, входящего в состав блока 3 синхронизации, четырнадцатый управляющий сигнал У„ управляет вентилем, разрешающим подачу так" товых импульсов от блока 1 на вход

С2 PAMK. При .подаче тактового импульса на данный вход осуществляется запись адреса следующей микрокоманды в регистр. Кроме того, тактовые импульсы поступают на вторые входы элементов И 13, первые входы которых соединены с выходами ПЗУ. Этим обеспечивается формирование импульсных управляющих сигналов, что необходимо при считывании последовательности единичных сигналов. Запрещенное состояние вентиля индицируется узлом 26 индикации. Управляющий сигиan Уо под3

14291 ключен к у"лу 16 коммутации и является источником синхронизирующих сигналов для счетчика 8 с переменным модулем счета. Высокий потенциал на уп5 ранляющем входе 17 соответствует подаче синхроимпульсов на тактовый вход счетчика 8, низкий потенциал обеспе- чивает подачу псевдослучайной последовательности от генератора 2 на 10 синхровход счетчика 8, Управляющий сигнал У блока 3 синхронизации предназначен для сброса в ноль триггера останова в режиме выполнения микропрограмм. Синхросигналы У„ -Уо предназначены соответственно для синхронизации первого регистра

6, синхронизации генератора 2 установки начального состояния блока 2, увеличения на единицу счетчика 4, ин- 20 крементации счетчика 9, синхронизации регистра 11 сброса в ноль регистров 11 и 14, синхронизации блока

12, управления чтением/записью блока

15 памяти, синхронизации второго ре- 25 гистра 7.

Счетчик 4 предназначен для формирования сигнала останова для блока 3 синхронизации при окончании прохождения теста. Информация о длине тес- 30 товой последовательности заносится от блока 5 путем установки соответствующего кода на информационных входах D -Эщ счетчика и установки режима занесения на входах Я„и Я ° 35

Блок 5 представляет собой набор двухпозиционных переключателей, а также формирователь 9 импульса сброса блока.

Первый и второй регистры 6 и 7 40 предназначены для подачи константных логических значений на входы счетчи-. ка 8. Сигналы, записаж ые в регистры, содержат информацию о входах/выходах проверяемой схемы, а также о подмно- 45 жествах множества входов объекта контроля. Аппаратная реализация регистров может быть выполнена с использованием интегральных микросхем К 155

ИР1,3, 50

Счетчик 8 (фиг. 6) содержит m DVтриггеров с управляющими входами, (m-1) элементов ИЛИ и (m-1) элементов 2-2И-ИЛИ, причем инверсные выходы триггеров соединены с их информацион- 55 ными входами, V-входы триггеров сое-. динены между собой и представляют собой разрешающий вход счетчика с переменным модулем счета, кроме того, 21 управляющие R- и Б-входы саатнетстнующих триггеров, кроме m-ro, являются входами соответствующих элементов

ИЛИ, выходы которых являются управляющими входами элементов 2-2И-ИЛИ, выход кажцага из которых, кроме (m-1)-га, соединен с синмронизирующим нхо ;ом последующего триггера и вторым информационным входом последующего элемента 2-2И-ИЛИ, а выход (m-1)-го элемента 2-2И-ИЛИ соединен с синхронизирующим входом m-Io триггера, причем прямые выходы D-триггеров, кроме ш-rо, подключены к первым информационным входам элемента 2-2ИИЛИ, кроме того, второй информационный вход первого элемента 2-2И-ИЛИ соединен с синхранизирующнм входам первого триггера н является синхравходом счетчика с переменным модулем счета, R- u S-входы триггеров образуют группу входов блока 8, выхсдами которого являются прямые выходы Dтриггеров.

Совместна с другими блакамн устройства счетчик 8 реализует заданные режимы работы:

1. Формирование последователь -;ости равновераятных двоичных символов с эталонными статистическими характеристиками (псевдослучайные последовательности), 2. Формирование последовательности двоичных символов с изменяемой вероятностью их появления .

3, Формирование логических констант.

4, Формирование теста типа "бегущий код (в частном случае — бегущий ноль" и "бегущая единица").

5, Формирование функций счета.

Совокупность структурных компонентов счетчика 8 и регистры 6 и 7 позволяют реализовать вышеупомянутые типы последовательностей на заданном множестве входов объекта контроля, что приводит к сокращению общего времени тестирования.

Счетчик 8 функционирует следующим образом. Если на S- н R-входах триггеров каждого из разрядов отсутствуют единичные сигналы с выходов регистров 6 и 7, то элементы ИЛИ, входы которых соединены с S- u R-входами триггеров, будут формировать нулевой логический уровень, который разрешает прохождение сигнала с выхода предыдущего триггера на синхранхад па1429121 следующего через соответствующий вход пелектора. Л так как триггеры счетчиКа 8 включены по схеме со счетным

Входом, то при подаче на их V-входы логической единицы; блок 8 представляет собой ш-разрядный двоичный счет-, чик. Если же из.регистров 6 или 7 на один из управляющих входов некоторохо триггера и группы триггеров счет- 10 ика 8 поступает уровень логической диницы, то последние устанавливаютв соответствующее состояние "0" пи "1", а соответствующие элементы

1И формируют управляющие сигналы, оторыа позволяют исключить данные !риггеры из цепочки последовательнос-!, и соединенных элементов памяти счетика 8, При этом образуется счетчик

< коэффициентом пересчета 2 ", где 20

- количество константных значений

r а выл оде счетчика с переменным моулем счета.

При включении режима псевдослучайной генерации на сийхронизирующий 25 вха,ц блока 8 через узел 16 подается сигнал от генератора 2 псевдослучайных чисел, а на разрешающий вход синхроимпульсы У, . При этом в ячейках памяти счетчика 8 осуществляется 30 сложение Iro rory rm rr rqr HHMorr B

rràHHrrrr момент времени информации и информации„поступающей из предыдущего разряда цепочки последовательно соединенных триггеров, что позволяет формировать на соответствующих выходах устройства псевдослучайные последовательности.

Счетчик 9 предназначен для формирования функций счета, подаваемых на входы мультиплексора 10 и группы

13 элементов И, Счетчик работает в двух режимах — режим параллельной записи информации с входов А,...,A и режим инкрементации. Выбор режима 45 осуществляется подачей соответствующего логического уровня на вход счетчика от блока 5 задания исходных данных. Импульсы сложения формируются блоком 3 синхронизации.

Третий регистр 11 предназначен для записи информации с выхода объекта контроля или произвольно выбранной точки комбинационной схемы с помощью щупа. Информация записывается при поступлении на С-вход регистра

11 импульса сдвига от блока 3. Сброс регистра осуществляется подачей соответствуюг;его импульса на вход H установки регистра в ноль.

Элемент И 12 предназначен для синхронной передачи информации с выхода комбинационной схемы на входы группы 13 элементов И. Элемент 12 представляет собой стандартный элемент булевой алгебры.

Группа 1 3 элементов. И содержит m двухвходовых элементов, к первым входам, которых подсоединены выходы двоичного счетчика 9, а вторые входы " к выходу элемента И !2 для подачи синхронизирующего сигнала в соответствующий момент времени.

Элементы индикации, которые могут бьггь установлены на триггерах 14, необходимы для визуального считывания . информации обслуживающим персоналом с целью формирования требуемых воздействий с помощью блока 3 синхронизации и блока 5 задания исходных данных.

Блок 15 необходим для накопления информации о подмножествах входов тестируемой схемы, влияющих на переключение заданной точки или выхода кбмбинационной части проверяемой схемы.

Необходимая информация из блока 15 в соответствующий момент времени извлекается и помещается в выбранный регистр 6 или 7. Адресные входы блока

15 соединены с выходами счетчика адреса блока 3, один из управляющих сигналов которого формирует строб записи или логический уровень чтения

ОЗУ.

Устройство работает следующим образом.

Информация о входах/выходах контролируемого устройства (логическая единица — вход, логический ноль — выход) набирается на переключателях блока 5. Упомянутые выходы соединены с информационными входами А„,...,Aù двоичного счетчика 9. Соответствующим переключателем блока 5 (второй выход четвертой группы выходов), соединенным с входом S задания режима работы блока 9, устанавливается режим параллельной записи. При этом двоичный счетчик выполняет функцию конвейернок го регистра, запись в который осуществляется путем подачи на синхровход импульса от блока 3 синхронизации.

Регистры 11 и 14 устанавливаются в ноль импульсом сброса, подаваемым от блока 3 синхронизации. После это-.

1429121 го вход блока 11 подключается к шине питания +5 В для создания на входе регистра 11 сдвига уровня логической единицы. Подачей синхроимпульс а данная информация записывается в первый триггер блока 11.

От блока 3 на вход элемента И 12 подается синхронизирующий импульс, который совместно с выходным сигналом 1О мультиплексора 10 (логическая единица) позволяет передать информацию через группу 13 элементов И с выходов блока 9 на входы группу триггеров 14.

При этом передаваемый код поступает 15 на $-входы триггеров группы, что позволяет осуществить необходимую перезапись (фиг. 4).

Блок 3 сигналом У„ устанавливает счетчик адреса блока 15 памяти в нулевое состояние, после чего на вход

"Чтение-Запись" блока 15 поступает строб записи У> который инициирует запись инверсной информации с выходов регистра 14 в нулевую ячейку памяти. 25 .Передача. инверсной информации необходима для того, чтобы информаия о входах/выходах, записанная в первый или второй сдвиговые регистры 6 или 7 соответственно, дозволяла исключать из 30 структуры счетчика 8 триггеры, выходы которых подают на выходы объекта контроля. Отключение соответствующего триггера осуществляется уровнем логической единицы, что обусловлено кон- 3 струкцией счетчика 8 с переменным мо- дулем счета, исходное же задание информации о входах/выходах является инверсным.

Цель описанных действий — передача4О информации о входах/выходах в регистр

6 или 7 для организадии исчерпывающего перебора кодовых комбинаций на входах проверяемой схемы. Соответствующая микропрограмма записывается в 45 . ПЗУ в. виде последовательности управляющих сигналов. Структура считываемой микрокоманды содержит поле адреса следующей микрокоманды Р„,...,В„ и поле управляющих сигналов У„,...,У„

Для обращения к данной микропрограмме на узле 27 блока 3 синхронизации набирается ее стартовый адрес (в данном случае — нулевой), что приводит к параплельному занесению информации, заданной на переключателях в регистр адреса микрокоманды и установке триггера условия останова в нулевое состояние, При этом индикатор

25 выключается. Нулевая микрокоманда разрешает прохождение импульсов синхронизации от блока 1 тактовых импульсон через элемент И 12 на вход

С2 регистра адреса микрокоманды (сигнал У„ ). Поле управляющих сигналов данной микрокоманды содержит сигналы управления Ys, У, У,, У„, которые позволяют осуществить запись информации о входах/выходах тестируемой схемы в счетчик 9, сбросить в ноль регистр )1 и группу триггеров 14, занести нулевую комбинацию в счетчик адреса блока 15 памяти соответственно. После выполнения нулевой микрокоманды осуществляется безусловный переход к выполнению микрокоманды, ад рес которой задан в поле D,,...,D>.

В данном случае осуществляется переход к первой микрокоманде, содержащей управляющие сигналы У6 — з апись логической единицы в нулевой триггер регистра 11, У вЂ” разрешение синхронизации. Далее осуществляется переход к микрокоманде с адресом 2. При выйолнении этой микрокоманчы управляющий сигнал У> синхронизирует блок 12, что приводит к записи информации о входах/выходах от блока 9 в триггеры

14 через группу 13 элементов И. Микрокоманда, записанная по третьему адресу, формирует строб записи У блока 15 памяти. Четвертая микрокоманда формирует сигнап У -синхронизации ре.гистра 6 сдвига:.с целью перезаписи информации из нулевой ячейки блока

15 памяти. Ъри этом предполагается, что на входы задания режима работы регистра 6 от блока 5 задания исходных данных подана комбинация логических сигналов, содержащая информацию о режиме параллельной записи в регистр. Иикропрограьжа завершается выполнением пятой микрокоманды, содержащей управляющие сигналы У, У, 7r что позволяет установить начальное состояние генератора 2 псевдослучайных чисел, занести информацию о длине тестовой последовательности с выходов блока 5 задания исходных данньгх в счетчик 4 длины теста, сбросить в ноль регистр 11 и триггеры 14.

После этого осуществляется переход к микрокоманде с адресом 6, не содержащим управляюших сигналов, т.е. выполняется команда "Останов". Нулевой логический уровень (сигнал УА) отключает генератор тактовых импуль142912) <„ов и работа устройства прекращается. авершение выполнения микропрограммы

<",опровождается включением индикатора 26.

Кроме вписанной выше микропрограммы з ПЗУ содержится другая микропроГрамма, позволяющий подобным образом занести необходимую информацию во которой регистр 7 сдвига. Выполнение

Этой микропрограммы предполагается сразу же после выполнения первой мик-!

Ропрограммы. Останов после выполнения первой микропрограммы обусловлен необходимостью смены исходных данных, Предназначенных для записи в регистр

7 сдвига, Д-нная микропрограмма рас1. олагается с седьмого по одиннадцатый адреса ПЯУ, Двенадцатая ячейка

11ЗУ содержит команду "Останов"., àíà- 2р логичную рассмотренной.

После выполнения указанных микропрограмм переключениями блока 5

1устанавливается режим хранения реги стров 6 и 7 сдвига, . режим счета счет- 25. чика 9. Уровень на управляющем вхопе узла 16 устанавливается в единичное значение, что соответствует заданию режж а счета счетчика, 8 с переменным модулем счета. Вход третье- 30 го регистра 11 сдвига соединяется с заданной точкой объекта контроля, .относительно которой необходимо построить вектор-строку двоичных цифр,,единичные сигналы в котоРой будут соответствовать входам схемы, влияющим на переключение данной точки.

Микропрограмма перебора кодовых комбинаций на входах объекта контроля

t начинается сттринадцатого адреса. 4р

По этому адресу считываются управляющие сигналы У, Уб, У „, У 1. По сигналу У осуществляется инкрементация счетчика 4, сигнал У является сигналом записи выходной информа. ции объекта контроля в регистр 11.

По сигналу У„ осуществляется добавление единицы в счетчик 8 с переменным модулем счета. Поле адреса следующей микрокоманды содержит адрес текущей микрокоманды, что обуславливает выIIîëíåíèe перечисленных операций в течение времени, необходимого для перебора всех комбинаций на входах схемы, IIpH переполнении счетчика 4 длины55 теста сигнал "Останов" поступает на

H-вход триггера останова и устанавливает его в единичное состояние, При этом очередная команда считывается из ячейки ПЗУ с адресом 2++В ( — тринадцатая ячейка) . Эта команда позволяет осуществить условный переход к микрокоманде с адресом 14, и, кроме того, сигналом У, установить триггер останова в нулевое состояние, Микрокоманда с адресом 14 служит для увеличения на единицу содержимого счетчика 9 (сигнал У ) и осуществления перехода к микрокоманде с адресом 15.

Последняя, сигналами У1 и У осуществляет инкрементацию счетчика 4 и синхронизацию блока 12 с целью формирования разрешающего импульса для передачи содержимого блока 9 в регистр 14, после чего осуществляется переход к четырнадцатой микрокоманде. Эти две микрокоманды повторяются в цикле до тех пор, пока счетчик

4 длины теста не переполнится, после чего происходит установка триггера останова блока 3 синхронизации в единичное состояние сигналом переполнения и переход к микрокоманде с адресом 2 +С (С вЂ” пятнадцатая ячейка).

Данная микрокоманда сбрасывает триггер останова в ноль и осуществляет условный переход к микрокоманде с адресом 16, которая необходима для наращивания содержимого регистра адреса блока 15 (У, У„ ) с целью записи сформированной вектор — строки в последующую свободную ячейку памяти блока 15, Семнадцатая микрокоманда формирует строб записи ОЗУ и осуществляет переход к микрокоманде останова 18.

При необходимости сформировать другие векторы (для других точек схемы) необходимо осуществить перекоммутацию входа третьего регистра 11 сдвига и повторно обратиться к микропрограмме, расположенной начиная с тринадцатого адреса ПЗУ, После окончания формирования всех заданных строк можно перейти к режиму тестирования объектов контроля, Микропрограмма тестирования расположена начиная с девятнадцатого адреса

ПЗУ. Предварительно устанавливается режим параллельной записи регистра 6, информация о длине теста заносится в блок 4. Информация о длине теста для выбранной точки (или выхода схемы) может быть определена оператором при построении соответствующей векторстроки. При этом необходимо двоичную

1429121

) 2 комбинацию считать с индикаторов ре- гистра 14.

Обращение к девятнадцатой микрокоманде ПЗУ позволяет осуществить ус- 5 тановку нулевого кода в счетчик адреса блока 15 (сигнал У„) и перейти к выполнению двадцатой команды. Эта микрокоманда формирует импульс записи необходимой информации в счетчик 4 1О длины теста и.прибавление единицы в счетчик адреса блока 15. Иикрокоманда. расположенная по адресу 21, необходимая для формирования сигнала записи в один из регистров 6 или 7 (например,15 регистр 6) и перехода к микрокоманде

22 "останова". Это необходимо для установки режимов счета счетчика 4 и . режима хранения регистра 6 сдвига.

После этого осуществляется передача 20 управления в двадцать третью ячейку ПЗУ, управляющие сигналы в которой

У4 и У,< предназначены для инкрементации счетчиков 4 и 8, Двадцать третья команда А повторяется до тех пор, 25 пока не.произойдет переполнение счетчика 4 и не осуществится условный переход к команде останова с адресом

21+А.При этом тестирование заданной точки или выхода схемы завершается. ЗО

Для продолжения режима тестирования других точек схемы необходимо установить нужные режимы работы счетчика 4 и регистра 6 и обратиться к двадцатой микрокоманде ПЗУ. 35

Формула изобретения

Устройство для формирования тестов, содержащее генератор тактовых 40 импульсов, генератор псевдослучайных чисел, блок синхронизации, счетчик длины теста, блок задания исходных данных, два регистра сдвига, первый счетчик, причем выход генератора так- 45 товых импульсов соединен с тактовым входом блока синхронизации, первая группа выходов блока задания исходных данных соединена с информационныьы входами первого регистра сдвига, вто- 5О рая и третья группы выходов блока задания исходных данных соединены соответственно с информационными входами второго регистра сдвига и счетчика длины теста, выход переполнения кото-55 рого соединен с входом останова блока синхронизации, первый выход которого соединен с синхровходом первого регистра сдвига, второй. третий и четвертый выходы блока синхронизации соединены с установочным входом и синхровходом генератора псевдослучайI ных чисел и счетным входом счетчика длины теста соответственно, информационные входы которого соединены с четвертой группой выходов блока задания исхэдных данных, о т л и ч аю щ е е с я тем, что, с целью повышения быстродействия, в устройство введены второй счетчик, мультиплексор, третий регистр сдвига, элемент И, группа элементов И, группа триггеров, блок памяти и узел коммутации, причем пятая группа выходов блока задания исходных данных соединена с группой информационных входов второго счетчика, а шЕстая группа выходов блока задания исходных данных соединена с входами установки режима и сброса второго счетчика, вход прямо-о счета которого соединен с пятым выходом блока синхронизации, кроме того, группа

m-разрядных выходов второго счетчика (где m — разрядность тестового слова устройства) подключена к первой группе управляющих входов мультиплексора, группа информационных входов которо— го соединена с группой разрядных выходов третьего сдвигового регистра, i-й выход второго счетчика (i-=Г,m) соединен с первым входом :-го элемента И группы элементов И, вторые входы которых соединены с выходом элемент.:

И, первый вход которого является выходом мультиплексора, а второй вход элемента И соединен с шестым выходом блока синхронизации, выходы элементов

И группы соединены с входайи установки соответствующих триггеров группы, входы сброса которых соединены с седьмым выходом блока синхронизации и входом сброса третьего регистра сдвига, выходы триггеров группы соединены с информационными входами блока памяти, группа адресных входов которого соединена с группой выходов блока синхронизации, выход генератора тактовых импульсов соединен с первым информационным входом узла коммутации, второй информационный вход которого соединен с выходом генератора псевдослучайных чисел, управляющий вход узла коммутации соединен с первым входом задания режима работы устрой-, ства, первый и второй выходы узла коммутации соединены с разрешающим и счетным входами первого счетчика

1429121

К адрюснци

1прабпящт сигМи шинки с9ии s5 соответственно, а выходы блока памяти соединены с информационными входами первого н второго регистров сдвига, кроме того, восьмой выход блока синхронизации соединен с синхровходом второго регистра сдвига, девятый выход блока синхронизации соединен с синхровходом третьего регистра сдвига, информационный вход третьего 10 сдвигового регистра является вторым входом задания режима работы устройства, а разрядные выходы первого счетчика являются выходами устройства, разрядные выходы первого регистра сдвига соединены с входами установки в нулевое состояние соответствующих разрядов первого счетчика, входы установки в единичное состояние которых соединены с соответствующими разрядными выходами второго регистра сдвига.

1429! 21

Oi Й @Х

ЙФ d4NO8

An kaid

h ОУ

Е4 29l 2!

1429121

Co«6

0 йжа 11

Уиг.1

Составитель В,Леоненко

Редактор В,Бугренкова Техред Л,Сердюкова Корректор Г.Решетник

Заказ 5127/46 Тираж 704 Подписное

ВНИИПИ Государственного комитета СССР по делам изобретений и открытий

113035, Москва,- Ж-35, Раушская наб., д. 4/5

Производственно-полиграфическое предприятие, г. Ужгород, ул. Проектная, 4