Устройство для обнаружения и регистрациипотока ошибок дискретного канала связи
ОП ИСАНИЕ
ИЗОБРЕТЕНИЯ
К АВТОРСКОМУ СВИДЕТЕЛЬСТВУ
Соизз Советсиих
Социалистических
Республик
Н 04 L I /10 с присоединением заявки РЙ вЂ”. Государственный комитет СССР оо делам изобретений и открытий (23) Приоритет ОпУбликовано07. 06. 81 ° Бюллетень Щ 21 (53) УДК 621.395. .664 (088..8) Дата опубликования описания 10 .06. 81 (?2) Авторы изобретения Е.П.Ларичев, Е.В.Нестеркин, Е.Н.Океанов и И.И.Родькин (71) Заявитель (54) УСТРОЙСТВО ДЛЯ ОБНАРУЖЕНИЯ И РЕГИСТРАЦИИ ПОТОКА ОШИБОК ДИСКРЕТНОГО КАНАЛА СВЯЗИ Изобретение относится-к техник радиосвязи и может использоваться в аппаратуре для исследования дискретных каналов радиосвязи. По основному авт.св. - 593320 известно .устройство для обнарУжения и 5 регистрации потока ошибок дискретного канала связи, содержащее на входе блок обнаружения ошибок, а также I счетчик тактовых импульсов и регист10 ратор, например перфоратор, блок ключей, элемент ИЛИ, формирователь временных меток, блок промежуточной памяти, блок управления, при этом тактовый выход блока обнаружения оши15 бок подключен к входу счетчика тактовых импульсов, выход которого соединен со входами блока ключей и формирователя временных меток, выход которого подключен к входу "сброс" счетчика тактовых импульсов через элемент ИЛИ, к другому входу которого подключен выход блока ключей, а выход "знак ошибки" блока обнаружения ошибок подключен к соответствующему входу блока промежуточной памяти, выход которого подключен к входу регистратора, синхронизирующий выход которого через блок управления подключен к управлянхцим входам блока промежуточной памяти и регистратора Е11 Однако известное устройство не обеспечивает малого времени регистрации информации о потоке ошибок. Цель изобретения — сокращение времени регистрации путем сжатия регистрируемой информации о потоке ошибок. Для этого в устройство для обнаружения и регистрации потока ошибок дискретного канала связи, содержащее на входе блок обнаружения ошибок, а также счетчик тактовых импульеов и регистратор, например перфоратор, блок ключей, элемент ИЛИ, формирователь временных меток, блок промежуточной памяти, блок управления, при этом тактовый выход блока обнаруже836804 4 чика тактовых импульсов 2, выход каждого разряда которого соединен с соответствующим импульсным ключом блока ключей 4. С появлением сигнала ошибки все пять ключей этого блока открываются и двоичное число со счетчика тактовых импульсов 2, соответствующее номеру посылки, на которой происходит ошибка, записывается через дополнительный. элемент ИЛИ 11 в пять ячеек блока оперативной памяти 12. Одновременно в седьмую ячейку блока оперативной памяти )2 записывается сигнал вида ошибок. При записи числа импульсами с выхода блока ключей 4 через элемент ИЛИ 5 производится сброс счетчика тактовых импульсов 2 в нулевое состояние. Принимаемые и анализируемые блоком обнаружения ошибок 1 элементарные посылки разбиваются на блоки по тридцать одной посылке. Для этого с приходом каждой тридцать первой посылки формирователь временных меток Ь выдает импульс временной метки, который представляется цифрой в шифраторе временных меток 10 и по сигналу с распределителя управляющих сигналов. 9, вырабатываемого по сигналу с выхода блока управ-. ления 8, записывается в пять ячеек блока оперативной памяти 12 после записи числа, соответствующего номеру .ошибочной посылки в случае появления ошибки. Если ошибки не появляются в течение времени формирования временной метки, то сигнал с выхода шифратора временных меток 10 записывается в шестую ячейку блока оперативной памяти 12 . Регистратор 3 в каждом цикле своей работы выдает сигналы синхронизации, поступающие на блок ния ошибок подключен к входу счетчика тактовых импульсов, выход которого соединен со входами блока ключей и формирователя временных меток, выход которого подключен к входу "сброс" счетчика тактовых импульсов через элемент ИЛИ, к другому входу которого подключен .выход блока ключей, а выход "знак ошибки" блока обнаружения ошибок подключен к соответствующему l0 входу блока промежуточной памяти, выход которого подключен к входу регистратора, синхронизирующий выход которого через блок управления подключен к управляющим входам блока промежуточ- 15 ной памяти и регистратора, введены распределитель управляющих сигналов, шифратор временных меток и дополнительный элемент ИЛИ, при этом выход "ошибка" блока обнаружения ошибок соединен с другим входом блока ключей через распределитель управляющих сигналов, второй вход которого соединен с соответствующим управляющим входом блока промежуточной памяти, 25 соответствующий вход которого соединен с вьгюдом блока ключей через дополнительный элемент ИЛИ, а выход формирователя временных меток соединен с соответствующим входом блока 30 промежуточной памяти через шифратор временных меток, второй и третий входы которого соединены соответственно с токовым выходом распределителя управляющих сигналов и со вторым 35 входом дополнительного элемента ИЛИ. На чертеже представлена структурная электрическая схема устройства для обнаружения и регистрации потока 40 ошибок дискретного канаЛа связи. Устройство для обнаружения и регистрации потока ошибок дискретного канала связи содержит блок обнаружения .ошибок 1, счетчик тактовых импуль-45 сов 2, регистратор 3, блок ключей 4, элемент ИЛИ 5,, формирователь временных меток 6, блок промежуточной памяти 7, блок управления 8, распределитель управляющих сигналов 9, шифра50 тор временных меток 10, дополнитель-. ный элемент ИЛИ 11. Блок промежуточной памяти состоит из блока оперативнбй памяти 12, блока буферной памяти 13, ключей 14 и 15. Устройство работает следующим образом. Тактовые импульсы поступают на вход двоичного пятиразрядного счетуправления 8, который выдает в соответствующие моменты цикла работы регистратора 3 сигналы управления на перезапись информации из блока оперативной памяти 12 в блок буферной памяти 13 через сеть ключей 14, сигналы управления на регистрацию информации из блока буферной памяти l3 на бумажную ленту регистратора 3 через сеть ключей 15, сигналы на установку блока буферной памяти. 13 в исходное состояние, сигналы транспортировки ленты на продвижение бумажной ленты регистратором 3. При записи информации из блока оперативной памяти 12 в блок буФерной памяти 13 блоком управления 8 вырабатывается сигнал на установку блока оперативной памяти 12 в исходное состояние. Формула изобретения Устройство для обнаружения и регистрации потока ошибок дискретного канала связи по авт.св. В 593320, о т л и ч а ю щ е е с я тем„ что, с целью сокращения времени регистрации путем сжатия регистрируемой ин- . формации о потоке ошибок, введены распределитель управляющих сигналов, шифратор временных меток и дополнительный элемент ИЛИ, при этом выход "ошибка" блока обнаружения ошибок соединен с другим входом блока ключей через распределитель управляю 36804 d щих сигналов, второй вход которого соединен с соответствующим управляющим входом блока промежуточной памяти, соответствующий вход которого соединен с выходом блока ключей через дополнительный элемент ИЛИ, а выход формирователя временных меток соединен с соответствующим входом блока промежуточной памяти через шифратор )в временных меток, второй и третий входы которого-соединены соответственно с токовым выходом распределителя управляющих сигналов и со вторым входом дополнительного элемента ИЛИ. 1$ Источники информации, принятые во внимание при экспертизе 1. Авторское свидетельство СССР Ф 593320, кл. Н 04 L, )/10, 1974. ВНИИПИ Заказ 3207/4 Тираж 698 Подписное Филиал ППП "Патент г . Ужгород, ул. Проектная,4
