Накапливающий сумматор

 

Изобретение относится к автоматике и вычислительной технике. Цель изобретения состоит в расширении функциональных возможностей путем формирования инверсного и дополнительного кодов суммы, а также нулевого или единичного кодов на выходе устройства . Накапливающий сумматор содержит коммутатор 1, сумматор 2, дополнительный сумматор 3, регистр 4, группу элементов И 5, первый 6 и второй 7 элементы И, вход 8 операндов сумматоров , выход 9, тактирующий вход 10, вход 11 установки, первый 12 и второй 13 входы управления. 1 ил., 1 табл.

СОЮЗ СОВЕТСКИХ

СОЦИАЛ ИСТИЧЕСНИХ

РЕСПУБЛИК

А1 (l9) И1) (5р 4 С 06 F 7/50

8" Иащ

r Б г ; Ь 1 1 Q

ОПИСАНИЕ ИЗОБРЕТЕНИЯ

Н АВТОРСКОМ,Ф,СВИДЕТЕЛЬСТВУ

ГОСУДАРСТВЕННЫЙ КОМИТЕТ

IlO ИЗОБРЕТЕНИЯМ И ОТКРЫТИЯМ

ПРИ ГКНТ СССР (21) 4176741/24-24 (22) 05.01.87 (46). 23,01.89. Бюл. В 3 (72) С.В.Галкин и В.М.Иатвеев (53) 681.325.5 (088 ° 8) (56) Ав орское свидетельство СССР

И 1215109, кл. 6 06 F 7/50, 1984. применение интегральных микросхем в электронной вычислительной технике:

Справочник/Под ред. Б.Н.Файэулаева, Б,В.Тарабрина. М.: Радио .и связь, 1986, с,114, рис.5.59. (54) НАКАПЛИВАЮЩИЙ C7NHATOp (57) Изобретение относится к автоматике и вычислительной технике, Цель изобретения состоит в расширении функциональных воэможностей ° путем формирования инверсного и дополнительного кодов суммы, а также нулевого или единичного кодов на выходе устройства. Накапливающий сумматор содержит коммутатор 1, сумматор 2, дополнительный сумматор 3, регистр 4, группу элементов И 5, первый 6 и второй 7 элементы И, вход 8 операндов суммато. ров, выход 9, тактирующий вход 10, вход 11 установки, первый 12 и второй

13 входы управления. 1 ил., 1 табл.

1453400

Ре- Управление

Состояние выхода

1 0 . 0

* В=,а;

0 В + 1

1 В

0 0

1 1

2 0 1

3 1 1

4 1 1

5 1 0

6 1 0

40

П р и м е ч а н и е:  — информация 45 на выходе устройства; а;

i-е входное сло». во;  — инверсия

В, (В+1 — дополни- 50 тельный код В);

* †. произвольное состояние.

Если на входах 12 и 13 управления

55 присутствует сигнал логического нуля, то накапливающий сумматор работает в режиме передачи информации, поступающей на вход 8 и на выход 9 беэ из".

Изобретение относится к автоматике и вычислительной технике и может быть использовано в устройствах обра ботки цифровых сигналов.

Цель изобретения — расширение функциональных возможностей путем формирования инверсного и дополнительного, кодов суммы и единичного и нулевого кодовф 10

На чертеже приведена функциональная схема накапливающего сумматора.

Накапливающий сумматор содержит коммутатор 1, сумматор 2, дополнительный сумматор 3, регистр 4, группу 15 элементов И 5, первый б и второй 7 элементы И, вход 8 операндов сумматора, выход 9 результата, тактовый вход 10; вход 11 установки, первый 12 и второй 13 входы управления сумма- 20 тора.

Накапливающий сумматор работает следующим образом.

Режимы работы накапливающего сумматора представлены в таблице. 25 менения (режим 1). В этом случае коммутатор 1 сигналом логического нуля, присутствующим на его входе управления, переключается в режим передачи информации по первому каналу с входа

8 на первую группу входов сумматора 2.

2, Эта информация суммируется с нулевым кодом, поступающим на вторую группу входов сумматора 2 с выходом группы элементов И 5, на вторые входы которого подан сигнал логического нуля нуля с входа 13, и без изменения поступает на информационные входы регистра 4, кроме старшего разряда. На старший информационный разряд регистра 4 поступает сигнал логического нуля с выхода дополнйтельного сумматора 3, на все входы которого поданы сигналы логического нуля, так как нулевой сигнал присутствует на выходе переноса сумматора 2, а первый 6 и второй 7 элементы -И заблокированы нулевыми сигналами с входов 12 и 13 управления. Таким образом, при пос» туплении на тактовый вход регистра 4 синхросигнала с входа 10 входная информация переписывается на выход 9 устройства беэ изменений. В этом режиме сигнал на входе 11 установки может находиться в произвольном сос-. тоянии.

Для переключения устройства в режим накопления (режим 2) необходимо подать на вход 12 управления сигнал логического нуля, а на вход 13 управления — сигнал логической единицы.

Состояние сигнала на входе 11 установки — произвольное. В этом режиме коммутатор 1 работает по первому каналу, а группа элементов И 5 разблокируется сигналом логической единицы, поступающим на его вторые вхо" ды с входа 13 управления, и пропускает на вторую группу входов сумматора 2 число, записанное s регистре

4, кроме старшего разряда. Сумматор

2 производит сложение П-разрядных операндов и передает результат на информационные входы регистра 4.

Старший, (П+1)-й, разряд суммы вычисляется путем сложения в дополнительном сумматоре 3 сигнала с выхода переноса сумматора 2 и старшего разряда числа, записанного в регистре 4 и поступающего через открытый сигналом логической единицы второй элемент И 7 на вход переноса дополнительного сумматора 3. При поступз 145340 лении синхросигнала на тактовый вход регистра 4 в него переписывается сумма операнда, хранящегося в регистре 4, и операнда, поступающего на вход 8, После этого на вход 8 поступает очередное информационное слово и дальнейшая работа накапливающего сумматора происходит аналогично.

Для вычисления дополнительного кода числа, хранящегося в регистре 4 (режим 3), необходимо подать на входы

12 и 13 управления сигнал логической единицы, а на вход 11 установки - . сигнал логического нупя. При этом на вторую группу входов сумматора 2 поступает число, дополнительный код которого необходимо вычислить, а на .первую группу входов сумматора 2умноженный на 2 код числа, присутст- 2 вующего на выходах. сумматора 2, так как коммутатор 1 находится в режиме работы по второму каналу. В этом случае устойчивое состояние сумматора 2 описывается выражением 25

В + 2 (В+1) = (В+1).

Таким образом, спустя время переходного процесса, на выходах. суммы сумматора 2 будет сформирован дополнительный код числа, записанного в регистре 4 без учета старшего разряда. Преобразование старшего разряда производится в дополнительном сумматоре 3, который суммирует старший разряд выходного числа со старшим разрядом суммы сумматора 2 и с его выходным переносом, так как первый 6 и второй 7 элементы И находятся в открытом состоянии. При поступлении на вход 10 синхросигнала дополнительный код числа передается на выход 9 устройства.

Накапливающий сумматор, содержащий многоразрядный сумматор, регистр, информационные входы которого, кроме . старшего разряда, соединены соответственно с выходами суммы многоразрядного сумматора, а тактовый вход регистра соединен с тактовым входом сумматора, отличающийся тем, что, с целью расширения функциональных возможностей путем формирования инверсного и дополнительного кодов суммы и единичного и нулевого кодов, введены коммутатор, группа элементов И, дополнительный сумматор, два элемента И, причем информационные входы с первого по 1-й первой группы коммутатора, где 1 — разрядность операндов, соединены соответственно с входами операнда сумматора, шина . нулевого потенциала сумматора соединена с информационными входами с (1+1)-го íî и-й первой группы коме смутатора, где п)1од К(2 +2 ...+..

+2 ) (, и с входом перекоса многораз" рядного сумматора, информационные входы первой группы которого соединены соответственно с выходами коммутатора, первый информационный вход второй группы которого соединен с входом установки сумматора, выходы суммы многоразрядного сумматора с первого по (n-1)-й разряд соединены соответст-. венно с информационными входами с второго по и«. и второй группы коммутатора, вход управления которого соединен с первым управляющим входом сумматора и первым входом первого элемента И, второй вход которого.соединен с выходом старшего разряда суммы многоразрядного сумматора, информационные входы второй группы которого соединены соответственно с выходами элементов. И группы, первые входы которых соединены с вторым управляющим входом сумматора и первым входом второго элемента И, второй вход которого соединен с выходом старшего разряда регистра, выходы которого соединены соответственно с вторыми входами элементов И группы, выход переноса мно-... горазрядного сумматора, выходы перного и второго элементов И соединены соответственно с первым и вторым информационными входами дополнительного

Для реализации режима 4 необходимо подать на вход 11 установки сигнал логической единицы. Это равноцен- 4 но тому, что к дополнительному коду числа будет прибавлена единица, а это соответствует преобразованию дополнительного кода н инверсный.

В режиме формирования нулевого (единичного) кода на выходе устройства (режимы 5 и 6), происходит последовательная замена разрядов кода числа, присутствующего на выходе сумматора 2, сигналом логического нуля (единицы), находящимся на входе 11 установки, т.е, спустя время переходного процесса, при поступлении синхроимпульса на вход 10 синхрони0

4 зации на выход 9 устройства передается нулевой (единичный) код.

Формула изобретения

5 1453400 6 сумматора и входом его переноса, вы- гистра, выходы регистра соединены. ход. суммы дополнительного сумматора соответственно с выходами результата соединен с входом старшего разряда ре- сумматора.

Составитель M,Åñåíèíà

РедактоР Н,ТУпица ТехРед А.Кравчук Корректор С.Черни

„Заказ 7284/45 Тираж 667 Подписное

ВНИИПИ Государственного комитета по изобретениям и открытиям при ГКНТ СССР l13035, Москва, Ж-35, Раушская наб., д. 4/5

Производственно-полиграфическое предприятие, r. ужгород; ул. Проектная, 4